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雙核異構+TSN+NPU三連擊！意法新款STM32MP23x重塑工業邊緣計算格局
意法半導體宣布旗下STM32MP23x系列微處理器（涵蓋STM32MP235/233/231）已正式量產，瞄準成本敏感型工業AI應用場景。作為STM32MP25系列的延伸產品，該系列在保留NPU神經處理單元、Cortex-A35+M33異構架構、Linux/RTOS雙系統支持及帶時間敏感網絡（TSN）的高性能網絡接口等核心功能的同時，通過精簡16位DDR4/LPDDR4/DDR3L內存控制器及移除H.264硬件解碼模塊，實現成本優化，為工業邊緣設備部署輕量級機器學習提供高性價比解決方案。
2025-06-17
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解析DDR設計中容性負載補償的作用
關于容性負載的介紹，高速先生之前有寫過一遍文章《DDR3系列之容性負載補償，你聽都沒聽過？》，今天我們進一步研究一下。先來了解一下容性負載和感性負載對鏈路阻抗的影響。仿真鏈路模型如下圖所示。鏈路中有三段50Ω的理想傳輸線，第一段和第二段之間增加一個電容模擬容性負載，第二段和第三段之間增加一個電感模擬感性負載，鏈路末端是一個1KΩ的電阻相當于開路。利用TDR仿真工具看整個鏈路的阻抗情況。
2023-05-19
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Xilinx FPGA DDR3設計（一）DDR3基礎掃盲
DDR3 SDRAM 全稱double-data-rate 3 synchronous dynamic RAM，即第三代雙倍速率同步動態隨機存儲器。雙倍速率（double-data-rate），是指時鐘的上升沿和下降沿都發生數據傳輸；同步，是指DDR3數據的讀取寫入是按時鐘同步的；動態，是指DDR3中的數據掉電無法保存，且需要周期性的刷新，才能保持數據；隨機，是指可以隨機操作任一地址的數據。
2022-05-12
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【示波器旅行指南 | 工程師如何開啟一場說走就走的旅行？】之二：愜意“乘機”不動怒
以太網的智能識別身份信息，快速通過安檢；借助USB2.0快速通道及時到達候機口，買杯咖啡，剛好等登機；DDR3航班能夠將路程時間縮短三分之一，更快到達目的地；航行中實時探測到微小氣流顛簸，借助電子設備及時調整飛行姿勢，小泰完全不受影響；帶上新買的降噪耳機欣賞音樂，享受安全舒適的旅行...
2021-04-21
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方案分享：如何解決汽車虛擬儀表盤設計
本虛擬儀表方案采用高性能的i.MX6DL（Cortex-A9） 雙核CPU，搭配汽車級DDR3內存及eMMC存儲器，支持嵌入式Linux操作系統，支持2D、3D硬件圖形加速引擎，支持上電快速啟動，是液晶化儀表板的汽車級解決方案。
2016-12-26
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DDR1、DDR2、DDR3、DDR4、SDAM內存各有千秋，哪里不同？
在嵌入式系統中有各種不同種類的內存，它們在系統中發揮著不可或缺的作用。但是不同種類的內存發揮的作用也不同。本文主要講述的是DDR4,DDR3,DDR2,DDR1及SDRAM等內存之間的相同點和不同點，及其在嵌入式系統中發揮的作用。
2015-09-02
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PCB專家專場——DDX系列之derating
時序一直都是相對復雜的，而DDR2和DDR3時序設計時還有個叫derating的東西，暈！什么是derating呢？簡而言之就是對建立保持時間基準值的修正。
2015-07-21
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大家來找茬——任性的DDR2設計（上）
前面有講到設計人員因為沒有留意到DDR3主控沒有讀寫平衡功能，就按照常規的布線要求來走線，導致數據和時鐘信號長度差異較大，最終使得DDR3系統運行不到額定頻率。看來沒有讀寫平衡的DDR3，直接按照DDR2的設計規則來做還是比較靠譜的，那么DDR2的設計到底有哪些規則呢？我想大家肯定會比較感興趣吧。
2015-07-03
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高速先生：案例分享之DDR3不能運行到額定頻率
高速先生前面零零散散的寫了一些DDR3系列的文章，雖然有小部分的案例說到了問題點，但那只是為了引出主題而寫，而且只是點到為止，既然是案例，就要把問題的來龍去脈描述清楚，這個案例的問題是這樣的：
2015-07-02
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專家分享：DDR3多端口讀寫存儲系統用FPGA如何設計？
由于FPGA具有強大邏輯資源、豐富IP核等優點，基于FPGA的嵌入式系統架構是機載視頻圖形顯示系統理想的架構選擇。本文以Kintex-7系列XC7K410T FPGA芯片和兩片MT41J128M16 DDR3 SDRAM芯片為硬件平臺，設計并實現了基于FPGA的視頻圖形顯示系統的DDR3多端口存儲管理。
2015-03-16
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DDR3系列之容性負載補償，你聽都沒聽過？
容性負載？是負載呈容性，還是帶容性的負載？呵呵，這不一個意思嘛，中國的語言，難怪老外覺得很難搞懂，自己人都被繞暈了。負載怎么會呈容性呢？在多負載的情況下負載怎么會呈容性呢？
2015-02-17
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就是這么任性的DDR3設計，看專家怎么降服？
DDR3主控為國外知名公司的芯片，按說該芯片的常規設計對于我們的設計人員來說應該沒有太大的問題，但是，這個設計的硬件工程師出于后期調試和EMI的考慮在所有的數據信號線上加了串阻，這就使得原本就很緊張的布線空間捉襟見肘了，為此我們的設計人員叫苦不迭，這么緊張的空間怎么去繞等長呢？
2015-01-15
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